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審決分類 審判 査定不服 特17 条の2 、4 項補正目的 特許、登録しない。 H03K
審判 査定不服 2項進歩性 特許、登録しない。 H03K
管理番号 1280798
審判番号 不服2012-14801  
総通号数 168 
発行国 日本国特許庁(JP) 
公報種別 特許審決公報 
発行日 2013-12-27 
種別 拒絶査定不服の審決 
審判請求日 2012-08-02 
確定日 2013-10-22 
事件の表示 特願2009-126546「パルス幅変調(PWM)制御装置とその駆動方法」拒絶査定不服審判事件〔平成22年12月 9日出願公開、特開2010-278531〕について、次のとおり審決する。 
結論 本件審判の請求は、成り立たない。 
理由 第1 手続の経緯
本願は,平成21年5月26日の出願であって,平成23年8月25日付けで拒絶理由が通知され,同年11月28日に意見書とともに手続補正書が提出されたが,平成24年3月26日付けで拒絶査定がなされ,これに対して同年8月2日に拒絶査定不服の審判が請求されるとともに手続補正がなされ,同年11月28日付けで審尋がなされたところ,平成25年2月18日並びに同年2月25日に回答書が提出されたものである。


第2 補正却下の決定
[補正却下の決定の結論]
平成24年8月2日付けの手続補正を却下する。

[理由]
1.本件補正について
平成24年8月2日付け手続補正(以下,「本件補正」という。)は,その内容からみて,平成23年11月28日の手続補正書に記載された特許請求の範囲の第2項を,

「 【請求項1】
パルス幅変調(PWM)制御装置であって、
複数のPWM信号を提供するPWM装置と、
前記PWM装置と複数の駆動回路に電気的に接続されるコントローラーと、
からなり、
前記複数の駆動回路が連接する負荷容量に基づいて、前記PWM信号を制御し、前記複数の駆動回路を適宜有効、或いは、無効にすることを特徴とするパルス幅変調(PWM)制御装置。
【請求項2】
前記パルス幅変調(PWM)制御装置は、例えば6相のPWM装置があって、負荷がオーバーロードの時、4相のPWM信号を使用して駆動回路を有効にし、前記PWM装置は相1?4を前記コントローラーに出力し、前記コントローラーは演算処理後、番号1?4、或いは、3?6相、或いは、1、3、4、5の駆動回路を適宜有効にし、
軽負荷の時、前記PWM装置は、負荷電流および最大相数によってPWM出力相数を切り換え、
この時、前記コントローラーは、番号1?2、或いは、3?6の駆動回路を適宜有効にすることを特徴とする請求項1に記載のパルス幅変調(PWM)制御装置。」

から,平成24年8月2日付けの手続補正書の特許請求の範囲第2項に記載された,

「 【請求項2】
パルス幅変調(PWM)制御装置であって、
複数のPWM信号を提供する6相のPWM装置と、
前記PWM装置と第1、第2、第3、第4、第5、第6の駆動回路に電気的に接続されるコントローラーと、
からなり、
負荷がオーバーロードの時、4相のPWM信号を使用して前記駆動回路を有効にし、前記PWM装置は相1?4を前記コントローラーに出力し、前記コントローラーは演算処理後、前記第1?前記第4の駆動回路又は前記第3?前記第6の駆動回路又は前記第1、前記第3、前記第4、前記第5の駆動回路を適宜有効にし、
負荷が軽負荷の時、前記PWM装置は、負荷電流及び最大相数によってPWM出力相数を切り換えて、前記コントローラーに出力し、前記コントローラーは、前記第1?前記第6の駆動回路のうち2つの駆動回路を適宜有効にすることを特徴とするパルス幅変調(PWM)制御装置。」

とする補正を含むものである。


2.補正の目的について
本件補正は,本件補正前の請求項2において,軽負荷時の動作として「番号1?2、或いは、3?6の駆動回路を適宜有効にする」としていたものを,本件補正後に「前記第1?前記第6の駆動回路のうち2つの駆動回路を適宜有効にする」と変更することを含んでいる。ここで,本件補正前の「番号1?2、或いは、3?6の駆動回路を適宜有効」という特定では「番号1?2」の駆動回路と,「番号3?6」の駆動回路をまたがって選択する構成は含まれないのに対し,本件補正後の「前記第1?前記第6の駆動回路のうち2つの駆動回路を適宜有効」という構成では「番号1?2」の駆動回路と,「番号3?6」の駆動回路にまたがって2つの駆動回路を選択し有効にする構成を含むことになり,すなわち,本件補正後の構成が本件補正前の構成には含まれない構成を含むこととなる。したがって,この点で本件補正は特許請求の範囲の減縮には該当しない。またこの点の補正が請求項の削除,誤記の訂正,及び明りょうでない記載の釈明のいずれにも該当しないことも明らかである。
したがって、本件補正は、特許法第17条の2第5項の規定(補正の目的要件)に違反するので、同法第159条第1項において読み替えて準用する同法第53条第1項の規定により却下すべきものである。


なお,上記検討では,請求項2に係る補正が,補正の目的要件の何れにも該当しないと判断したが,仮に請求項2の補正が,補正の目的要件を満たしているとされる場合であっても,補正を却下するという結論が妥当であるか否かを検討しておく。
本件補正は,本件補正前の請求項1(上記「[理由]1.本件補正について」において,平成23年11月28日の手続補正書から引用した特許請求の範囲の記載の【請求項1】の部分参照。)に対して,複数の駆動回路を有効あるいは無効にする制御が「ランダムな順序で」行われるという限定を付加する補正を含むものである。そうしてみると,当該補正は「制御」の内容を限定するものであるから,特許請求の範囲の減縮に該当する。そこで,補正後の請求項1について,特許出願の際に独立して特許を受けることができるものであるかどうかについて次に検討する(独立特許要件)。
後述する「第3 本願発明について」において言及するように,本件補正前の請求項1は後述する引用発明及び周知の技術によって当業者が容易に想到できたものである。
また,本件補正によって付加された,複数の駆動回路を有効あるいは無効にする制御が「ランダムな順序で」行われるという構成については,複数の駆動回路の使用時間を平均化するために,使用する駆動回路をランダムに選択するという技術が,例えば特開平11-341816号公報(特に【0010】【0028】参照),特開2008-187865号公報,特開2002-44869号公報,特開2002-252935号公報(特に請求項3参照)に記載されているように周知技術にすぎないことを踏まえれば,当該周知技術を駆動回路の制御に単に適用することによって,当業者が格別の創意工夫を要することなく構成することができたものである。
そうしてみると,本件補正後の請求項1は引用発明に周知技術を単に適用したものにすぎないから,当業者が容易に想到できたものであり,本件補正後の請求項1は特許出願の際独立して特許を受けることができないものである。したがって、特許法第17条の2第6項において準用する同法第126条第7項の規定に違反するので、同法第159条第1項の規定において読み替えて準用する同法第53条第1項の規定により却下すべきものである。


第3 本願発明について
1.本願発明
平成24年8月2日付けの手続補正は上記のとおり却下されたので,本願の請求項1に係る発明(以下,「本願発明」という。)は,平成23年11月28日の手続補正書に記載された特許請求の範囲の請求項1の記載からみて以下のとおりのものと認められる。

「 【請求項1】
パルス幅変調(PWM)制御装置であって、
複数のPWM信号を提供するPWM装置と、
前記PWM装置と複数の駆動回路に電気的に接続されるコントローラーと、
からなり、
前記複数の駆動回路が連接する負荷容量に基づいて、前記PWM信号を制御し、前記複数の駆動回路を適宜有効、或いは、無効にすることを特徴とするパルス幅変調(PWM)制御装置。」


2.引用発明
原審の拒絶理由に引用された特開2008-263771号公報(以下,「引用例」という。)には,「動的に調整される多相レギュレータ」として図面とともに以下の事項が記載されている。

イ.「【0015】
図3は、図1のコンバータのある実施形態による、動的な位相制御を有する多相スイッチングDC-DCコンバータ(電圧レギュレータ)300を示す。コンバータ300は、一般的に、パルス幅変調器(PWM)(即ち、制御部)302、ドライバ部312、出力フィルタ部322、電流フィードバック部332、及び電圧フィードバック部342を含み、これらは図示するように結合されて、調整された電圧(VR)を負荷350に供給する(電流フィードバック部及び電圧フィードバック部は、図1のフィードバック回路106に対応しうる)。
【0016】
図示する実施形態では、ドライバ部312は、N個のドライバ(Di)を含み、電流フィードバック部332は、N個の電流センサ(I-Sensei)を含み、出力フィルタ部322は、N個のインダクタ(Li)及び1つのコンデンサCを含む。ドライバ(Di)は、電流センサ(I-Sensei)を介してインダクタ(Li)に結合され、N個の位相レグ304iを形成する。位相レグ304iは、図示するように、共通の出力電圧ノード(VR)に結合されて、電流を調整された負荷350に供給する。
【0017】
本願にて使用するように、用語「位相レグ」とは、1つ以上のインダクタ及び/又はコンデンサと調整された電圧ノードとに結合され、それにより、印加供給源(例えば、Vin)を当該の1つ以上のインダクタ及び/又はコンデンサを介して調整された負荷に制御可能に結合するドライバ(即ち、1つ以上のスイッチング及び/又は整流器素子)を指す。位相レグは、以下に限定しないが、バック、同期バック、ブースト、バック-ブースト、又はフライバックコンバータを含む任意の所望のコンバータスキーム用の多相コンバータの1つの位相を実施しうる。例えば、同期バック型コンバータでは、1つの位相レグ内のドライバ(Di)は、ドレインがインダクタに共通に接続され、それにより、インダクタを印加ハイサイド供給源、ローサイド供給源に切替え可能に結合し、又は、インダクタをトライステートにする相補型PMOS及びNMOSトランジスタを含みうる。その一方で、位相レグは、例えば、インダクタに結合されるトランジスタといったスイッチを使用し、インダクタは、スイッチが開である場合に当該インダクタに電流を供給するようスイッチ-インダクタノードに関連するロー供給源から結合されるダイオードを有する、標準バック型ドライバを実施するよう構成されてもよい。当業者には無数の他のドライバ及びインダクタ/コンデンサ実施形態が理解されよう。また、それらは、本発明の範囲内である。
【0018】?【0023】略
【0024】
PWM302は、位相レグを、関連付けられる印加電圧源(Vin)に制御可能に結合又は切断するよう、位相レグに供給されるべき制御(例えば、駆動)信号(P1乃至PN)を生成する。PWM302は更に、引き出される負荷電流(IAVGにより示される)に依存して、位相レグ3042乃至304Nをそれぞれ選択的に有効又は無効にする位相有効化(EN2乃至ENN)信号を生成する。
【0025】
動作時に、PWMは、関連付けられるインダクタを印加電圧源(Vin)に制御可能に結合する駆動信号(P1乃至PN)を生成する。供給される駆動信号(Pi)に基づいて、ドライバ(Di)は、その供給された駆動信号のデューティサイクルに比例して、インダクタ(Li)を介して負荷に供給される平均電流量を制御し、従って、負荷電圧(VR)を調整するよう使用することができる。従って、駆動信号(Pi)は、出力負荷電圧(VR)を調整するために「パルス幅変調された」と言える。
【0026】
駆動信号(P1乃至PN)は、時間的にスキュー(位相シフト)され、それにより、各インダクタからのスイッチングノイズは、時間的に分散される。これはリップルを減少し、また、単一の位相レグによって供給されるより多い総電流量が負荷に供給されることを可能にする。PWM302は、平均負荷電流(IAVG)を監視し、それを、1つ以上の閾値と比較して、動作負荷電流範囲に対し所望の効率となるよう適切な数の位相(位相レグ)を有効にさせる。負荷電流が、次に高い「ウィンドウ」に増加するに従って、PWMは、追加の位相(位相レグ)と関連付けられる。反対に、負荷電流が次に低いウィンドウに下がると、PWMは、1つの位相をドロップアウトする(離す)。このようにして、大部分において、PWMは、1位相あたりの平均電流を所望の効率範囲内に維持する。」

ロ.「【0029】
図4は、例えば、3位相の多相コンバータ用のある実施形態によるPWM302の一部を示す。PWM302は、一般的に、制御/DLL(遅延ロックループ)回路402、加算回路404-408、2:1スイッチ410、比較器412-416、及びヒステリシス比較器418、420を含み、図示するように結合される。
【0030】
制御/DLL回路402は、基準信号401を受信し、その基準信号から、4つの基準位相信号CP1乃至CP4を生成する。CP1は、0°の位相角を有し、CP2は、120°の位相角を有し、CP3は、240°の位相角を有し、CP4は、180°の位相角を有する。図示する実施形態では、基準信号は、所望の位相角を有するクロックを生成するようDLL回路の基準位相として使用されるクロック(例えば、パルス列)信号である。異なる位相にずらされたパルスクロックは、次に、CPi信号を供給するよう対応する位相角を有する三角信号に変換される。しかし、他のアプローチを使用してもよい。
(以下略)
【0031】?【0033】略
【0034】
ヒステリシス比較器418及び420は、3位相(P1、P2、及びP3)のうち関連付けられるべき位相の数を決定するために使用する。本願に記載した他の機能回路ブロックと同様に、これらの比較器は、以下に限定しないが、アナログ回路素子、デジタル論理素子、機械コード等を含む任意の好適な回路を使用して実施されうる。これらの比較器はともに、正の入力において、平均負荷電流信号(IAVG)を受信するが、比較器418は、負の入力において、固定基準信号(Vref3)を受信し、一方、比較器420は、負の入力において、固定基準信号(Vref2)を受信する(Vref3の値は、Vref2の値より大きい)。IAVGがVref3より高い(従ってVref2より高い)場合、EN3及びEN2信号がともにアサートされ3つ全ての位相が有効にされる。その一方で、IAVGはVref2より高いがVref3より低い場合、EN3はデアサートし、EN2はアサートし、それにより、位相3はドロップオフされ、位相1及び2だけがアクティブとなる。最後に、IAVGがVref2より低い(従ってVref3より低い)
場合、EN3及びEN2はともにデアサートし、位相3及び位相2の両方を無効にし、位相1だけがアクティブとなる。従って、Vref3は、1位相あたりの電流平均が3つの位相をアクティブにするには非効率的に低くなる点と一致すべきであり、Vref2は、1位相あたりの電流平均が2つの位相をアクティブにするには非効率的に低くなる点と一致するよう選択されるべきである。
【0035】略
【0036】
IAVGがVref3を下回ると、EN3はデアサートし、これにより位相3は無効にされる(なお、位相は、ドロップオフされると、任意の好適な方法で、負荷から隔離される又は一部の他の方法によって無効にされうる。例えば、適切な有効化信号により制御されるトランジスタスイッチを使用して、関連付けられるスイッチ電力レグを負荷から隔離しうる)。
【0037】
さらに、EN3がデアサートすることで、スイッチ410は、CP2ではなくCP4を選択する。これは、比較器414における基準三角波が120°ではなく180°の相対位相角となることをもたらす。従って、2つのアクティブ位相、即ち、位相1及び位相2は、0°及び180°においてそれぞれ均等に再分散される。更に、各位相のセンス電流は、その関連付けられる比較器に(PID信号に加えて)負のフィードバックで供給されることに留意されたい。これは、安定状態と過渡条件の両方に対して妥当なロード・バランシングをもたらす。なぜなら、任意のスイッチ電力レグが早く「上がり」過ぎても、関連付けられる駆動信号(Pi)のデューティサイクルの減少によって抑制されるからである。これらの回路技術は、より大きい数の位相に拡大適用されうることを理解すべきである。より多くのスイッチが必要となるが、十分な数のタップポイントを有する基準位相源を使用することで、異なる位相に対する必要な位相の組み合わせ(他の位相が除去又は追加されるに従って)は、十分に均等な位相分散に対して妥当に実施されうる。」

上記引用例の記載及び関連する図面並びにこの分野の技術常識を考慮すると,
上記摘記事項イ.やロ.の記載や,図3,図4の記載を参照すれば,パルス幅変調器(PWM)302は複数の駆動信号(図3のP_(1)ないしP_(N),もしくは,図4のP_(1)ないしP_(3))を出力している。これらはいずれもPWM信号であるから,パルス幅変調器(PWM)302はPWM信号である複数の駆動信号を出力するものといえる。
引用例において,上記摘記事項ロ.【0034】及び図4によれば,パルス幅変調器(PWM)302に内蔵されるヒステリシス比較器418,420はそれぞれEN3,EN2を生成し,図3及び【0024】をみれば,ヒステリシス比較器を含むパルス幅変調器(PWM)302は,複数のEN信号(EN2?ENN)を生成し,これらは複数の位相レグ(3042?304N)に含まれるドライバ部312に出力されているからヒステリシス比較器418,420からなる回路は複数の位相レグに電気的に接続されているということができる。
引用例において,摘記事項イ.の【0024】に「PWM302は更に、引き出される負荷電流(IAVGにより示される)に依存して、位相レグ3042乃至304Nをそれぞれ選択的に有効又は無効にする位相有効化(EN2乃至ENN)信号を生成する。」と記載され,また,摘記事項ロ.の【0034】に「IAVGがVref3より高い(従ってVref2より高い)場合、EN3及びEN2信号がともにアサートされ3つ全ての位相が有効にされる。その一方で、IAVGはVref2より高いがVref3より低い場合、EN3はデアサートし、EN2はアサートし、それにより、位相3はドロップオフされ、位相1及び2だけがアクティブとなる。最後に、IAVGがVref2より低い(従ってVref3より低い)場合、EN3及びEN2はともにデアサートし、位相3及び位相2の両方を無効にし、位相1だけがアクティブとなる。」と記載されていることからみて,ヒステリシス比較器418,420からなる回路は,平均負荷電流信号(IAVG)に基づいて,EN2,EN3を適宜アサート,あるいはデアサートし、複数の位相レグを適宜,有効あるい無効にするようにされている。そして,図3をみれば,複数の位相レグの出力が負荷にともに接続され,負荷に流れる合計の電流が平均負荷電流信号(IAVG)である。
また,引用例記載のものは,PWM変調によって制御を行っている装置であることは明らかだから,PWM変調制御装置ということができる。

したがって,引用例には,以下の発明(以下,「引用発明」という。)が記載されているものと認められる。

(引用発明)
「PWM変調制御装置であって,
PWM信号である複数の駆動信号を出力するパルス幅変調器(PWM)302と,
パルス幅変調器(PWM)302に内蔵され,複数の位相レグに電気的に接続されている複数のヒステリシス比較器(418,420)からなる回路と,
からなり,
前記ヒステリシス比較器(418,420)からなる回路は,複数の位相レグが接続される負荷に流れる平均負荷電流信号(IAVG)に基づいて,EN2,EN3を適宜アサート,あるいはデアサートし、複数の位相レグを適宜,有効あるい無効にするPWM変調制御装置。」


3.対比
本願発明と引用発明を対比すると,
引用発明の「PWM変調制御装置」は,後述する点で異なるものの,PWMはパルス幅変調を表すから,本願発明の「パルス幅変調(PWM)制御装置」に対応する。
引用発明の「パルス幅変調器(PWM)302」は,複数のPWM信号を出力するとともに,EN2,EN3を適宜アサート,あるいはデアサートする「ヒステリシス比較器(418,420)からなる回路」を含んでいるから,引用発明の「パルス幅変調器(PWM)302」から「ヒステリシス比較器(418,420)からなる回路」を除いた構成が,本願発明の「PWM装置」に相当する。
引用発明の「位相レグ」は負荷に接続され,これに電流を供給し駆動している回路であるから本願発明の「駆動回路」に相当する。
引用発明の「ヒステリシス比較器418,420からなる回路」は,少なくとも「複数の位相レグ」に接続され,位相レグを制御しているから,本願発明の「コントローラー」に対応する。
引用発明は,「複数の位相レグが接続される負荷に流れる平均負荷電流信号」を基づいて位相レグの有効・無効の制御を行っているのに対して,本願発明は「負荷容量」に基づく制御を行っている点で両者は相違するものの,「負荷」に関連して制御するという点では両者は共通する。また,当該制御は,引用発明では「複数の位相レグを適宜,有効あるい無効に」制御している点で,本願発明の「前記複数の駆動回路を適宜有効、或いは、無効にする」制御と共通する。

したがって,両者は,以下の点で一致ないし相違する。

(一致点)
「パルス幅変調(PWM)制御装置であって、
複数のPWM信号を提供するPWM装置と、
複数の駆動回路に電気的に接続されるコントローラーと、
からなり、
前記複数の駆動回路が連接する負荷に基づいて、前記複数の駆動回路を適宜有効、或いは、無効にすることを特徴とするパルス幅変調(PWM)制御装置。」

(相違点)
(1)本願発明の「コントローラー」は「前記PWM装置」に接続されているのに対して,引用発明では明確ではない点。

(2)「負荷に基づいて、前記複数の駆動回路を適宜有効、或いは、無効にする」に関して,本願発明は「負荷容量」に基づくのに対して,引用発明では「負荷に流れる平均負荷電流信号」に基づく点。

(3)「前記複数の駆動回路を適宜有効、或いは、無効にする」制御が,本願発明では「前記PWM信号を制御し」て行われているのに対して,引用発明では明確ではない点。


4.当審の判断
事案にかんがみ,はじめに相違点(1)と(3)について検討する。
相違点(1)及び(3)とした本願発明の構成は,「コントローラー」が「前記PWM装置」に接続され,「前記PWM信号を制御し、前記複数の駆動回路を適宜有効、或いは、無効にする」構成であるが,当該構成について,本願の発明の詳細な説明の実施例の記載や,図2の記載を参照すれば,「コントローラー」が「PWM装置」に電気的に接続されることで当該「PWM装置」からPWM信号を受け取り,これを複数の駆動回路に供給するときにPWM信号を制御し,複数の駆動回路を適宜有効、或いは、無効にしていると解することができる。
そこで,引用発明をみると,引用発明ではヒステリシス比較器(「コントローラー」に相当)からなる回路は,パルス幅変調器(PWM)302からは駆動信号は受け取らず,複数の位相レグを直接制御しているものであるが,一般に前段回路によって生成された複数の信号によって後段の複数の回路を選択的に動作させる場合,前段回路によって生成された複数の信号を受け,これを後段の回路に選択的に供給することによって行うことは,いわゆるスイッチャーなどのように従来より周知の構成にすぎない。そうしてみると,引用発明においても前段のパルス幅変調器(PWM)302から複数の駆動信号を受け取り,これを選択的に後段の複数の位相レグに接続し,相違点(1)及び(3)のような本願構成とすることは設計を行う上で格別の困難を必要とせず,当業者が容易に想到できたものである。
なお,本願発明では「前記PWM装置・・・に電気的に接続されるコントローラー」と特定されているのみであるが,これが仮にPWM装置がコントローラーによって制御されるということを意味しているとしても,引用例においてもヒステリシス比較器418の出力によってスイッチ410が制御されているから,格別の相違はない。

次に,相違点(2)について検討する。本願発明の「負荷容量」について明細書には直接定義した記載はないものの,【0015】に以下のように記載されている。
「・・・例えば、6相のPWM制御装置があって、負荷がオーバーロードの時、4相のPWM信号を使用して、駆動回路を有効にし、PWM装置210は相1?4をコントローラー220に出力し、コントローラーは演算処理後、番号1?4、或いは、3?6相、或いは、1、3、4、5の駆動回路を適宜有効にする。軽負荷の時、PWM装置210は、負荷電流、および、最大相数によって判断し、PWM出力相数を2相に切り換え、つまり、2組の駆動回路だけ有効にする。この時、コントローラー220は、番号1?2、或いは、3?6の駆動回路を適宜有効にすることができる。・・・」
上記記載によれば,負荷がオーバーロードになる場合と軽負荷のときで相数を切換えているが,この切換は「軽負荷の時、PWM装置210は、負荷電流、および、最大相数によって判断し」と記載されていることからみて,「負荷電流」と「最大相数」に基づいて行なわれている。ここで最大相数は予め決められている数値であるから,主に「負荷電流」をみて,大きな負荷電流が流れるときは負荷容量が大きいと判断され,負荷電流が小さいときには負荷容量が小さいと判断していると解される。そうすると,「負荷に流れる平均負荷電流信号」に基づいて制御を行っている引用発明とこの点において格別の相違はなく,相違点(2)は格別のものではない。

そして,本願発明が奏する効果も,引用発明及び周知技術から予想できる範囲のものである。


5.むすび
以上のとおり,本願の特許請求の範囲の請求項1に係る発明は,上記引用発明及び周知技術に基づいて当業者が容易に発明をすることができたものであるから,特許法第29条第2項の規定により特許を受けることができない。
したがって,本願は,他の請求項について検討するまでもなく,拒絶すべきものである。

よって,結論のとおり審決する。
 
審理終結日 2013-05-21 
結審通知日 2013-05-27 
審決日 2013-06-07 
出願番号 特願2009-126546(P2009-126546)
審決分類 P 1 8・ 57- Z (H03K)
P 1 8・ 121- Z (H03K)
最終処分 不成立  
前審関与審査官 矢頭 尚之  
特許庁審判長 菅原 道晴
特許庁審判官 山本 章裕
矢島 伸一
発明の名称 パルス幅変調(PWM)制御装置とその駆動方法  
代理人 磯野 富彦  

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